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「兩大法寶」帶來千倍算力,埃米時代或提前到來|CCF Chip 2022

本文作者: 姚勇喆 2022-08-02 11:42
導語:算力和功耗兩手都要抓。

雷峰網(wǎng)(公眾號:雷峰網(wǎng))消息,7月30日,首屆中國計算機學會芯片大會(CCF Chip 2022)在南京開幕。英特爾研究院副總裁、英特爾中國研究院院長宋繼強進行了以“堅持半導體底層技術創(chuàng)新,激發(fā)算力千倍級提升”為主題的演講。

演講中,宋繼強向我們分享了英特爾對于如何突破算力瓶頸的思考,展示了英特爾基于異構計算和異構集成技術所取得的成就和英特爾“埃米級”先進制程的相關情況。

「兩大法寶」帶來千倍算力,埃米時代或提前到來|CCF Chip 2022

千倍算力時代即將到來

隨著科技日新月異的發(fā)展,應用場景變得越來越復雜,而這些應用場景想要落地需要更高的算力。比如近年火爆的元宇宙概念,雖然目前很多廠商都已經(jīng)做出了嘗試,但離人們心目中真正的元宇宙還是相去甚遠。

要想實現(xiàn)真正“身臨其境”的元宇宙,需要足以支撐起虛擬場景的龐大算力。2021年,英特爾加速計算系統(tǒng)和圖形組的負責人Raja Koduri曾表示“要為元宇宙提供動力我們需要比今天強大的多的技術,計算效率要比現(xiàn)在的先進水平提高1000倍。”

隨著摩爾定律的放緩,要達到這一算力水平似乎變得愈來愈艱難,但隨著計算架構和封裝技術的革新,這個未來正在一步步向我們走來。

宋繼強在演講中提出,面對目前的算力需求,傳統(tǒng)的單一計算架構已經(jīng)達到性能和功耗的瓶頸。要想實現(xiàn)算力進一步的飛躍,需要依靠異構計算和異構集成兩大“法寶”。

異構計算就是用不同的架構處理不同類型的數(shù)據(jù),做到“物盡其用”,用合適的工具解決合適的問題。這能夠大大提高算力的利用率。

但這些不同架構的芯片可能并不是同一制程,無法整合到同一SoC中,這就需要異構集成技術。

異構集成是指能夠把不同工藝下制造的芯片集成到同一芯片中的先進封裝工藝,這使得異構計算利用不同架構芯片形成更高效的解決方案成為了可能。

宋繼強介紹道,目前2.5D的EMIB封裝技術已經(jīng)可以把平面上集成的芯片很好的連接,并將凸點間距有效降低到50微米以下,并且未來可能繼續(xù)降低至30-45微米的級別。

而3D封裝的Foveros技術則能夠把不同計算的芯粒在垂直層面上封裝,目前Foveros Omni技術已經(jīng)可以做到將凸點間距降至36微米,未來Foveros Direct技術則可以將凸點間距降到10微米以下。

英特爾的Ponte Vecchio就是這兩種技術的集大成者。這一SoC中集成了來自5個不同制程節(jié)點,分別由英特爾和臺積電制造的47種不同芯片。在水平層面上采用了EMIB技術,在垂直方向上則采用了Foveros技術封裝。

在異構計算和異構集成之外,對神經(jīng)擬態(tài)芯片的探索也是打破算力瓶頸的重要途徑。

宋繼強指出,目前的人工智能大多數(shù)依然是依靠GPU、CPU或者是加速器,他們的本質依然是乘加器的跌價。而神經(jīng)擬態(tài)芯片則是用模擬人類神經(jīng)元的方式構造其中底層的計算單元。

如果構造出這種芯片,再通過脈沖神經(jīng)網(wǎng)絡的方式編程人工智能算法,將有機會達到能效比千倍提升。在同樣的能耗下,能夠達到目前乘加器芯片的千倍算力。

制程推進加速,埃米時代或將提前到來

在探索打破瓶頸的同時,功耗也是一個必須要考慮的問題。

一千倍的算力不能以一千倍的功耗作為代價,否則算力的提升將會變得毫無意義。

要想降低芯片的功耗,就需要更先進的制程工藝。

隨著摩爾定律在傳統(tǒng)設計工藝中逐漸式微,如何延續(xù)摩爾定律成為了芯片未來發(fā)展的一個重要命題。

在今年2月的英特爾投資人日上,英特爾首席執(zhí)行官帕特曾經(jīng)充滿憧憬的宣布了英特爾在先進制程上的探索計劃,并表示摩爾定律至少還會持續(xù)十年。

按照規(guī)劃,英特爾將在四年時間內跨過五個制程節(jié)點:Intel4制程的芯片將在2022年下半年投產,Intel3芯片將在2023年下半年投產,而埃米級的Intel20A制程和Intel18A的芯片將在2024年推出。

在本次CCF Chip 2022的演講中,宋繼強給我們帶來了英特爾這番宏偉規(guī)劃的最新進展。

宋繼強表示,已經(jīng)投產的Intel 7制程芯片產能已達3500萬片,首次采用了EUV光刻機的Intel 4制程也即將推出。

在演講中,宋繼強帶來了更多“埃米級”芯片的細節(jié):在Intel 20A節(jié)點中,英特爾將會使用RibbonFET新結構。

這一結構能夠進一步降低平面上晶體管所占面積,同時使晶體管獲得更快的驅動速度。

而在晶體管供電層面上,英特爾將在Intel20A中引入PowerVia技術實現(xiàn)供電層和邏輯層的完全分開,用底部給上層的功能邏輯部件供電,這將能更有效地使用金屬層,可以很大程度上簡化繞線和減少功耗。

宋繼強還透露,英特爾在Intel 20A和Intel 18A埃米級制程的研發(fā)上目前取得了非常不錯的進展,預計這兩個節(jié)點將會比預計的更早應用到產品中。

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